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Synopsys IC Compiler II 2018.06 Linux64

IC Compiler II 新一代布局与绕线(place-and-route)解决方案,以全新的多执行绪架构为基础,并具备超高容量设计规划、独特的时脉建造技术和先进的整体分析收敛技术,可协助客户在进行晶片实体设计时,提升达10倍整体设计效能的生产力。同时,IC Compiler II也已成功协助多家晶片领导大厂完成投片(tapeout)。
IC Compiler II是以新的多执行绪架构为中心之全功能布局绕线系统,能因应超过5亿个instances的晶片设计,该解决方案还参照了产业标准的输入(input)和输出格式以及常见介面和制程技术档案,同时引进创新的设计储存功能。此外,从初始的研发开始,IC Compiler II的开发便着重于全晶片层级,并采用创新的设计规划能力,来达到10倍速的效能提升,同时将记忆体的耗用减少达5倍。因此,这项解决方案能协助设计人员快速评估众多晶片设计平面规划的选项,以便在适当的时机着手进行晶片实作。
IC Compiler II解决方案也具备区块层级(block-level)的各种功能,并且与上述晶片层级功能互补,其背后的支援技术包括新的整体分析最佳化引擎、全新的时脉产生器以及独特的绕线后(post-route)最佳化演算能力,结合这几项技术可提升面积、时序和功耗的品质(QoR)。
此外,IC Compiler II也纳入IC Compiler中的技术如conjugate-gradient布局器和ZRoute绕线器等。和现有解决方案相较,IC Compiler II平均可达到5倍速的执行时间,并减少2倍记忆体空间。执行速度的增加辅以更好的平面规划,再加上可实现的QoR以及轻量的作业环境,IC Compiler II能减少设计iteration的发生,进一步提升设计生产力。


Synopsys IC Compiler II 2018.06 Linux64 (布局与绕线) | 1428.3 mb

IC Compiler II is a complete netlist to GDSII place-and-route system that enables 10X faster throughput for designs across all process nodes, while improving final quality of results (QoR). IC Compiler II is specifically designed to address today’s hypersensitive time-to-market pressures while delivering best-in-class solutions for flat and hierarchical design planning, early design exploration and prototyping, placement and optimization, clock tree synthesis, routing, manufacturing compliance, and low-power challenges.
IC Compiler II is a complete place and route system that enables 10X faster throughput for designs across all process nodes. Hear what Antun Domic, executive vice president and general manager of Synopsys’ Design Group, has to say about this new physical implementation solution.

Language: English
Operating Systems: RHEL 5.x-7.x 64Bit

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