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Synopsys IC Compiler 2018.06 SP1 Linux64

IC Compiler是新一代布局布线系统(Astro是前一代布局布线系统),通过将物理综合扩展到整个布局和布线过程以及签核驱动的设计收敛,来保证卓越的质量并缩短设计时间。上一代解决方案由于布局、时钟树和布线独立运行,有其局限性。IC Compiler的扩展物理综合(XPS)技术突破了这一局限,将物理综合扩展到了整个布局和布线过程。
IC Compiler采用基于TCL的统一架构,实现了创新并利用了Synopsys的若干最为优秀的核心技术。作为一套完整的布局布线设计系统,它包括了实现下一代设计所必需的一切功能,如物理综合、布局、布线、时序、信号完整性(SI)优化、低功耗、可测性设计(DFT)和良率优化。新版ICC运行时间更快、容量更大、多角/多模优化(MCMM)更加智能、而且具有改进的可预测性,可显著提高设计人员的生产效率。同时,新版本还推出了支持45nm、32nm技术的物理设计。IC Compiler正成为越来越多市场领先的IC设计公司在各种应用和广泛硅技术中的理想选择。新版的重大技术创新将为加速其广泛应用起到重要作用。
IC Compiler引入了用于快速运行模式的新技术,在保证原有质量的情况下使运行时间缩短了35%。新技术将16Gb平台的容量增加到接近1,000万门,有助于用户实现更大的模块划分。新版增加了集成的、层次化的设计规划的早期介入,有助于用户高效处理一亿门级的设计。提高生产能效的另一个关键在于物理可行性流程,它能够使用户迅速生成和分析多次试验布局,以确定具体实现的最佳起始值。


Synopsys IC Compiler 2018.06 SP1 Linux64 (布局布线系统) | 850 Mb

IC Compiler place and route system is a single, convergent, chip-level physical implementation tool. It includes flat and hierarchical design planning, placement, clock tree synthesis, routing and optimization, manufacturability, and low-power capabilities that enable on schedule delivery of advanced designs.
Key Benefits

  • High throughput for designs in mainstream silicon technologies
  • High performance for advance silicon technologies
  • Comprehensive optimization capability: Area, Timing, Test, Power and Yield
  • Standard input/output interfaces:
    • Netlist input: database or ASCII
    • GDSII out
    • Milkyway libraries
  • IC Compiler for implementation and concurrent hierarchical design
  • Highly correlated with golden sign-off: PrimeTime® and Star-RCXT™
  • Optimized for best performance and predictability used with Design Compiler®

Language: English/简体中文/Multilingual
Operating Systems: Windows 7/8.x 64Bit/RHEL 5.x-7.x

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